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用GALl6V8器件设计一个十进制同步计数器。

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第1题

用XC4000系列器件实现一个4位十进制同步计数器,最少需占用几个CLB?

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第2题

用JK触发器设计一个如图所示功能的同步五进制计数器,要求具有自启动能力。

用JK触发器设计一个如图所示功能的同步五进制计数器,要求具有自启动能力。

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第3题

设计一个同步11进制减计数器。要求用JK型边沿触发器和少量门电路实现。

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第4题

一个六位二进制数10■■■0,其中三位未知。设计算法,求所有符合上述形式的六位二进制数之和s(用十进制表示)(1)符合上述形式的六位二进制数共有()

A.1个

B.7个

C.8个

D.3个

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第5题

用JK触发器设计一个同步六进制加1计数器。

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第6题

用JK触发器设计一个同步十二进制计数器,要求具有自启动功能,并画出电路的状态转换图。

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第7题

用负边沿触发型JK触发器和门电路设计一个同步八进制加/减可逆计数器。

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第8题

有一个十进制数加法运算系统,它利用4位二进制数加法器对一位8421BCD码进行加法运算.其操作过程如下:先将两个1位十进制数存入寄存器A和B,然后进行相加.如果和数等于或小于9,则运算结果正确;如果和数大于10,还需要对运算结果进行加6(0110)修正,这是因为用二进制数表示十进制数时,多余了6种状态.(1)请设计系统方框图;(2)请设计ASM流程图.
有一个十进制数加法运算系统,它利用4位二进制数加法器对一位8421BCD码进行加法运算.其操作过程如下:先将两个1位十进制数存入寄存器A和B,然后进行相加.如果和数等于或小于9,则运算结果正确;如果和数大于10,还需要对运算结果进行加6(0110)修正,这是因为用二进制数表示十进制数时,多余了6种状态.(1)请设计系统方框图;(2)请设计ASM流程图.

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第9题

图6.24所示电路是用二一十进制优先编码器74LS147和同步十进制计数器74160组成的可控分频器,试说明当输入控

制信号A、B、C、D、E、F、G、H、I分别为低电平时由Y端输出的脉冲频率各为多少?已知CLK端的输入脉冲频率为10kHz。

图6.24所示电路是用二一十进制优先编码器74LS147和同步十进制计数器74160组成的可控分频器

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第10题

用Protel低版本设计的原理图器件库,在Protel99SE中不能编辑?
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